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無線電子工学および電気工学の百科事典
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MPEG 2.5 LAYER III STA013/013B/013T オーディオ デコーダ。 参照データ

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無線電子工学と電気工学の百科事典 / マイクロ回路の応用

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概要

STA013 は、MPEG 1、MPEG 2、および MPEG 2.5 仕様の MPEG Layer III オーディオ ストリーム用の完全に統合されたユニバーサル デコーダです。 このチップの主な機能は次のとおりです。 次の圧縮オーディオ信号形式を完全にサポートします。

  • ISO/IEC 11172-3 (MPEG 1 オーディオ) および ISO/IEC 13818-3.2 (MPEG 2 オーディオ) 規格のレイヤ III。
  • MPEG 2.5 として知られる低サンプル レート ストリーム。
  • ステレオ、デュアルチャンネル、シングルチャンネル(モノラル)モードのレイヤーIIIストリーム。

さらに、マイクロ回路は以下を提供および備えています。

  • MPEG1およびMPEG2のすべての標準サンプリングレートに加えて、MPEG2.5の拡張周波数セットのサポート:48。 44,1; 32; 24; 22,05; 16; 12; 11,025および8kHz;
  • 2.5 ~ 8 kbps のエンコード レートで MPEG 320 Layer III ストリームをサポート。
  • 出力信号のチャネル切り替えのソフトウェア制御。
  • 出力信号レベルのデジタル制御。
  • 出力信号の低周波および高周波のレベルのデジタル制御(音色制御);
  • データのシリアルインターフェースの操作。
  • 出力シリアルインターフェイス(PCM)のソフトウェア制御データ形式のサポート。
  • 低消費電力(85V電源電圧および最大信号サンプリングレートで2,4mW);
  • 入力データの整合性チェック (CRC) と入力ストリーム同期エラーの検出 (外部コントローラーによるこれらのエラーの登録の可能性あり)。

マイクロ回路はバスIを介して制御されます2C.

周波数 10、14,31818、および 14,7456 MHz の外部水晶共振器をマイクロ回路に接続できます (他の周波数もサポートできますが、これには適切なバージョンの内部ソフトウェア (ファームウェア) が必要です。マイクロ回路の主な範囲はオーディオ機器です。 MP3 フォーマットのサポート付き: CD プレーヤー、MP3 プレーヤー、ミュージック センター 低電圧供給と低消費電力により、このチップはポータブルおよびポータブル デバイスに特に適しています マイクロ回路の主な特性を表 3 に示します。

表1

の特性
チップ供給電圧、V 2,1 ... 3,6
消費電力、mW:\サンプリング周波数24kHz \ 32kHz \ 48kHz \76\79\85
使用温度範囲、 oC -20 ... + 125
出力信号レベル制御範囲、dB -96 ... 0
出力レベル調整ステップ、dB 1
高音レベル調整範囲、dB -18 ... + 18
低音レベル調整範囲、dB -18 ... + 18
周波数レベル制御ステップ (高低)、dB 1,5
リセット信号持続時間 (RESET)、µs 少なくとも0,1

STA013 チップの主なサブシステム

マイクロ回路のブロック図を図1に示します。 XNUMX. 入力シリアル インターフェイスは、外部ソースから入力データ ストリームを受信するために使用されます。 ビット順 - 送信されたバイトの最上位ビットが最初に送信されます。 データは SDI 入力経由で受信され、SCKR 入力の信号レベルの変化に同期されます。 同期調整 (パルスのエッジまたは立ち下がりでのデータの受信) は、プログラムによって実行されます。 BIT_EN 入力のロー レベルは、入力インターフェイスによるデータの受信を無効にします。

MPEG 2.5 LAYER III STA013 / 013B/013Tオーディオデコーダー。 参照データ。 STA013チップの構造図
米。 1. 超小型回路の構造図

周波数シンセサイザと同期モジュールは、マイクロ回路のコンピューティング コアと出力オーディオ インターフェイス用のクロック信号を生成するために使用されます。 出力サンプル レートは、OCLK リサンプリング レートをソフトウェア定義の係数で割ることによって得られます。 周波数シンセサイザは、一般的な DAC チップのほとんどを駆動する出力信号を生成できます。

出力シリアル インターフェイスは、デコードされたオーディオ データを PCM 形式で出力するために使用されます。 データは SDO ラインを介して送信され、SCKT 出力でクロックされます。 同期調整 (パルスのエッジまたは立ち下がりでのデータ送信) はプログラムで実行されます。 LRCKT 出力の信号レベルは、データ ワードが送信されているチャネル (左/右) を示します。 信号表現の精度は、16、18、20、または 24 ビットの 16 つの値からソフトウェアで選択できます。 32 ビットの表現精度を選択すると、LRCKT 信号の 18 周期で 20 ビットのデータが送信されます。 表現精度が 24、64、または XNUMX ビットの場合、LRCKT 信号の XNUMX 周期で XNUMX データ ビットが送信されます。 送信データのフォーマットはソフトウェアによって制御されるため、シリアル データ転送プロトコルをサポートするさまざまな種類の外部 DAC をチップに接続できます。

I2Cインターフェースは、外部マイクロコントローラーを使用してマイクロ回路の動作モードを制御するため、およびマイクロ回路モジュールの現在の状態に関する情報を取得するために使用されます。 マイクロ回路のすべての調整パラメータは内部レジスタに記録され、Iバスに書き込むことができます。2C. チップのコンピューティング コアは、MP3 オーディオ ストリームのデコード、デジタル信号フィルタリング、およびチップ クロック モジュールの制御を提供する高性能デジタル シグナル プロセッサ (DSP) です。

チップ動作モード

STA013 チップは、マルチメディア モード (MM) またはブロードキャスト モード (以降、BM と呼びます) の 013 つのモードで動作できます。 MM モードでは、入力データ ストリームは、DATA_REQ 出力の信号レベルを変更することにより、STA013 チップ自体によって制御されます。 この出力のアクティブ信号は、データを STA013 チップに送信する必要があることを外部ソースに示します。 このモードで動作する場合、SRC_INT ピンを電源に接続する必要があります。 BM モードでは、入力データ ストリームはデータ ソースによって完全に制御されます。 実際の入力データ レートと指定された公称レートとの間に不一致が生じた場合、STAXNUMX マイクロ回路は必要な内部同期を自動的に提供します。 BM モードは、主にウェアラブル デバイスまたはポータブル デバイスでのチップ動作に必要です。

各実施形態のマイクロ回路のピン配列が図1に示されている。 スイッチング回路を図2に、スイッチング回路を図3に示します。 4とXNUMX。

MPEG 2.5 LAYER III STA013 / 013B/013Tオーディオデコーダー。 参照データ。 STA013チップのピン配列
米。 2. マイクロ回路のピン配置

MPEG 2.5 LAYER III STA013/013B/013T オーディオ デコーダー。 参照データ。 配線図 STA013
米。 3.スイッチング方式

MPEG 2.5 LAYER III STA013/013B/013T オーディオ デコーダー。 参照データ。 配線図 STA013
米。 4.スイッチング方式

STA013チップのピン割り当てを表に示します。 2。

表2

出力番号 指定 説明
ハウジングSO8 エンクロージャ TQFP44 パッケージ LBGA64
1 29 B5 VDD_1 供給電圧
2 30 B4 VSS_1 共通線
3 31 A4 SDA 出口を入力してください。 バスデータライン I2C
4 32 B3 SCL 入口。 バスクロックⅠ2C
5 34 A1 SDI 入口。 シリアル入力データライン
6 36 B2 SCKR 入口。 シリアル入力クロック
7 38 D4 BIT_EN 入口。 入力妥当性信号
8 40 D1 SRC_INT 入口。 入力ソースからの割り込み信号
9 42 E2 S.D.O. 出口。 シリアル出力データライン (PCM デコードデータ)
10 44 F2 SCKT 出口。 シリアル出力クロック
11 2 H1 LRCKT 出口。 チャネルデータクロック(L / R)
12 3 H3 OCLK 出口を入力してください。 外部 DAC のオーバーサンプリング クロック
13 5 F3 VSS_2 共通線
14 6 E4 VDD_2 供給電圧
15 7 G4 VSS_3 共通線
16 8 G5 VDD_3 供給電圧
17 10 F5 PVDD 周波数シンセサイザーの供給電圧
18 11 G6 PVSS 周波数シンセサイザの共通線
19 12 G7 filt 出口。 クロック出力フィルタ
20 13 G8 XTO 出口。 水晶振動子の接続
21 15 F7 XTI 入口。 水晶振動子の接続
22 19 E7 VSS_4 共通線
23 21 C8 VDD_4 供給電圧
24 22 D7 テスト 入口。 テストモードの有効化
25 24 A7 スキャネン 入り口
26 25 B6 RESET 入口。 ハードウェアリセット信号
27 26 A5 VSS_5 共通線
28 27 C5 OUT_CLK/DATA_REQ 出力バッファ クロック/データ要求信号

著者:ウラジミール・ザイツェフ。 出版物: cxem.net

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