5000分周器。スキーム、説明

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5000 による周波数分周器。無線エレクトロニクスと電気工学の百科事典

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トランシーバーでデジタルスケールを使用すると、周波数を読み取る際のオペレーターの快適さが向上するだけでなく、DAC システムを使用する簡単な方法で VFO 周波数の安定性が大幅に向上します。デジタルスケールには通常、パルスをカウントする正確な時間間隔を取得するために必要な水晶発振器と分周器が含まれています。原理的には、トランシーバーが独自の水晶局部発振器を備えているという事実を利用して、この発生器をデジタルスケールから除外して簡素化することができます。この場合、共通の発生器が使用されるため、すべてのパルス信号は自動的に同期されます。さらに、デバイス内の発生器が少ないほど、高調波や影響を受ける周波数が少なくなり、設計がシンプルになります。つまり、無線コンポーネントが明らかに節約されます。

多くのトランシーバー (UW3DI など) は、周波数 500 kHz の局部発振器を使用します。その信号を事前に周波数を 5000 で割ったデジタルスケールに適用すると、安定した繰り返し周波数 100 Hz のパルスが得られます。これは、ほとんどの場合、計数時間間隔を形成するために必要です。

5000による分周器
図。 1

図に示す回路に従って、K561IE16 バイナリカウンタ上にこのような係数を持つ分周器を構築するのは簡単です。 1. XNUMX 進カウンタで同じ係数を持つ一般的な分周器よりも使用するマイクロ回路の数が大幅に少なくなります。

周波数 1 kHz の入力アンプパルス整形器がトランジスタ VT500 に組み込まれています。 DD1 チップ (シリアルキャリーを備えた 14 ビットバイナリカウンタ) には、初期状態設定 R とカウント C の 1 つの入力があります。後者は、トランジスタ VTXNUMX のコレクタからパルスを受け取ります。これらは立ち下がりエッジ (高論理レベルから低論理レベルへの変化) によってカウントされます。ハイ論理レベル信号が R 入力に印加されると、カウンタトリガは元のゼロ状態に戻ります。

要素 DD2.1、DD2.2、および DD3.1 の AND 論理ノードには、除算係数の 5000 進表現にある入力と同じ数の入力がなければなりません。私たちの場合はXNUMX₁₀= 1001110001000₂、論理ノードの入力は出力 2 に接続する必要があります。³ （8）、2⁷ （128）、2⁸（256）、2⁹ (512) と 2¹² (4096)。指数は、除算係数の 5000 進表現における桁の序数 (最下位ゼロから始まる) に対応することに注意してください。この場合、使用される数字の重みの合計は、指定された除算係数である 3.1 に等しくなります。カウンタによって蓄積された数がこの値に達すると、要素 DDXNUMX の出力およびカウンタの入力 R のレベルが High になり、カウンタはリセットされ、カウントサイクルが最初から始まります。

同様に、K561IE16 チップ上で、最大 2 までの任意の分周係数を持つ分周器を構築できます。¹⁴-1 (16383)。 9 V の電源電圧での最大動作周波数は 4 MHz (実際にはもう少し高い) であることを考慮する必要があります。この電圧に比例して変化します。

5000による分周器
図。 2

K561IE16 マイクロ回路には、重み 2 の XNUMX つを除くすべてのカウンタートリガーからの出力があります。¹ (2) と 2² (4)。必要な除算係数を実装するためにそのような出力だけが必要な場合は、別の下位ビットバイナリカウンタを K561IE16 (DD1) カウンタと並列に接続することで構成できます。たとえば、図に示すように。 2、K561IE10 チップ (DD4.1) のカウンターの 1 つ。カウンタ DD2 と同期して動作する場合、その出力の重みは XNUMX になります。⁰ （1）、2¹ （2）、2²(4) と 2³とします。

コンデンサ C2 は、電源投入時にメーターを初期リセットするために使用されます。ダイオード VD2、VD3、および抵抗 R3 は OR ノードを形成し、電源投入時の要素 DD3.1 の出力からのゼロ化パルスをカウンタ入力 R で論理的に加算します。

電源をオフにした後、コンデンサ C2 の放電時間が数分に達する場合があることに注意してください。これを低減するには、必要に応じて、コンデンサ C2 と並列に 1 MΩ の抵抗を接続することをお勧めします。

著者：オルガレズナヤ

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