無線電子工学および電気工学の百科事典 デジタル周波数コンバーター。 無線エレクトロニクスと電気工学の百科事典 無線電子工学と電気工学の百科事典 / アマチュア無線デザイナー 安定した繰り返し率のパルスは通常、必要な(ほとんど整数の)回数だけ周波数を下げる分周器を使用して水晶発振器信号から形成されます。 ただし、必要な水晶振動子がないために、初期周波数と必要周波数の比が整数でない場合が多く、分数変換係数の分周器を使用する必要があります[1、2]。 確かに、それらが形成する振動の周期は一定ではありませんが、一部のデバイスではこれは重要ではありません。 読者には、同様のデバイスの別のバージョンが提供されます。その動作原理は次のとおりです。 発電機信号の周波数 f が必要な値 f の合計であると想像すると、0 と絶対誤差 df から周波数 f を取得します。0 減算演算を実行するだけで十分です: f0=f-df. 実際には、繰り返し周波数 f のパルスのシーケンスから、最も近い整数に四捨五入された番号 n=f/df の各パルスを削除することになります。 たとえば、f=10147 kHz の場合、af0=10000 kHz、次に df =147 Hz、n=10147/147=69,27、つまり 69。したがって、元のシーケンスから 69 番目ごとのパルスを除外すると、f が得られます。0=ff/69=10147-10147/69=9999,943 kHz。 この場合、削除されたパルス数の丸めによる相対誤差は -5,7*10 に等しくなります。-6 発生器を調整することで簡単に除去できます。 この方法を実装する周波数変換器のブロック図を図1に示します。 1.カウンタD2、デコーダD2、およびリセットおよびロックパルスジェネレータG1は、変換係数nの分周器を形成します。 水晶発振器G1から番号nのパルスが到着すると、信号がデコーダD2の出力に現れ、それが発振器G2をオンにする。 それによって生成された単一のパルスは、D2キーの入力の2つに到達し、それをブロックすると同時に、カウンターD3をゼロに設定します。 遅延線DT1は、水晶発振器G1のパルスを、分周器ノードの動作の遅延と同じかそれよりわずかに長い時間遅延させる。 これにより、スイッチD1の入力で信号を同時に受信できるようになり、ジェネレータG1のパルス幅が十分である場合、番号nのパルスがシーケンスから除外されます。 その後、コンバータの新しい動作サイクルが始まります。
n=10143,57で繰り返し周波数f=68kHzの水晶発振器パルスコンバータの概略図を図に示します。 2. 水晶発振器は、[1.1] で説明されている回路に従って DD3 素子上に作成されます。 要素 DD1.2 はバッファ要素です。 カウンタはマイクロ回路 DD2、DD3 で作成され、デコーダは要素 DD4 で作成されます。 水晶発振器パルスが DD1.4 スイッチに通過する際の遅延は、R2C2 回路によって提供されます。 図に示されている定格の遅延時間 (t=R2С2) は約 16 ns です。 明示的なリセットおよびブロッキングパルス発生器はありません。 その機能は、適切に接続された要素 DD1.3 とマイクロ回路 DD2 ~ DD4 によって実行されます。
コンバータの動作は、図に示すタイミング図で示されます。 3. ジェネレータの 2 番目のパルス (図 4、a) がカウンタ DD68 とデコーダ DD3 の入力に到着するまでに、デコーダのすべての入力 (図 1、c ~ e) で遅延付きでレベル 3 が設定されます。ターンオン時間 (th.DD4) レベル 0 が出力に現れ (図 3、e)、DD1.4 キーの入力の XNUMX つに影響を与えます。 時間 t の遅れにより、t にほぼ等しいh.DD4、ジェネレータの 68 番目のパルスは同時にキーのもう一方の入力に到着しますが (図 3、b)、キーが閉じているため (図 3、h)、デバイスの出力には伝わりません。 遅延時間t後h.DD1.3スイッチされ、要素 DD1.3 がカウンタ DD0、DD2 の R3 入力でスイッチされ、レベル 1 が表示され (図 3、g)、リセット時間 tz.reset の後、カウンタはゼロに設定されます。 その結果、スイッチング時間 t 後、h.DD4 デコーダ DD4 の出力にレベル 1 が再び表示され (図 3、e)、キーが開きます。
キー ブロッキング パルスの持続時間は、合計遅延時間 t によって決まります。h.DD1.3+tリセット+th.DD4 前述のケースでは約 60 ns です。 これは、シーケンスから約 50 ns の持続時間のパルスを削除するのに十分です。 デコーダ入力をカウンタ出力に接続するための 10143,57 つのオプション (n = 67、68、70、71 に対応) について、繰り返し周波数 f = 3 kHz の水晶発振器パルスから得られる出力信号の周波数値は、次のようにまとめられています。表は、df がデコーダ出力のブロッキング繰り返し周波数パルスです (測定には Ch33-10000 周波数計を使用しました)。 ご覧のとおり、必要な周波数値 (71 kHz) に最も近い周波数値は、n = 1 で得られます (コンデンサ CXNUMX を選択することで、さらに周波数を下げることができます)。
水晶発振器のパルスの持続時間がブロックパルスよりも長い場合、除外されたパルスの一部がデバイスの出力に伝わり、必要な周波数の信号を受信するプロセスが中断されます。 この欠点を解消する最も簡単な方法は、ジェネレータからのパルスのデューティ サイクルを増やすことです。 デューティサイクルコンバータは、図に示す回路に従って作成できます。 4 に示されており、[4] で説明されています。
その動作のタイミング図を図に示します。 5. デバイスは周波数変換器の要素 DD1.1 と DD1.2 の間に接続されます。 この場合、要素 DD1.2 の出力のパルスは、水晶発振器の任意の周波数で要素 DD5.1 ~ DD5.3 の合計遅延時間 (45...55 ns) に等しい持続時間を持ちます。
説明した周波数コンバータには、広範な追加機能があります。 完全なカウンタとデコーダを使用すると、2 ~ 256 番目のパルスごとにブロックすることができます。つまり、除算係数を 2 から 1+1/256 に変更し、カウンタの容量を変更し、複数のコンバータを直列に組み込むことで、正確な値を取得できます。低周波数を最低コストで実現します。 このデバイスは、入力周波数を XNUMX つの成分に「スプリッター」として使用できます。0 そしてDF。 この場合、デコーダの出力から取得されたパルスは一定の繰り返し周期を持ち、水晶発振器信号の分周係数は f/df に等しくなります。 カウンタ出力とデコーダ入力間に論理スイッチを設けることで、バイナリコード信号を用いてデバイスの除算係数を直接制御し、コード周波数変換器や周波数変調器などに使用できます。 このコンバータは、加算演算 f を実装することで、分数周波数乗算 (整数倍ではない) にも正常に使用できます。0=f+df。 これを行うには、番号 n=f/df の各パルスを 2 つの部分に「カット」し、元のシーケンスに追加のパルスを追加する必要があります。 所望の動作モードを得るのは非常に簡単です。遅延回路 R2C4 を、DD12 デコーダの出力からのパルスが DD1.4 素子のピン 70 に供給される回路に転送するだけで十分です。 この場合、ブロッキング パルスはジェネレータ パルスより少なくとも 100 ~ 155 ns 短くなければなりません (K1.2 シリーズ マイクロ回路の場合)。 発電機のパルス持続時間が短い場合、要素 DD4 の代わりにデューティ サイクル コンバーターがオンになります (図 XNUMX)。 この場合のデバイス動作のタイミング図を図 6 に示します。 XNUMX.
逓倍モードでは、周波数 f = 1014,36 kHz の水晶共振器を使用してコンバータをテストしました。n = 68 で、周波数 f が得られました。0=1029,277kHz。 コンバータの信頼性の高い動作のためには、遅延時間 t を 10 ~ 30 ns の範囲で選択する必要がある場合があることに留意してください。 文学
著者: A.サモイレンコ、ノヴォロシースク 他の記事も見る セクション アマチュア無線デザイナー. 読み書き 有用な この記事へのコメント. 科学技術の最新ニュース、新しい電子機器: 交通騒音がヒナの成長を遅らせる
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